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SX1211
WIRELESS & SENSING
Data Rx
(to SR)
“noisy” data
Preamble
Sync
b0
b1
b2
b3
b4
b5
b6
b7
b8
b9
b10
b11 b12 b13 b14 b15 b16
Start condition
(Cf. Fifo_fill_method)
/Fifoempty
Fifofull
Fifo_overrun_clr
Write_byte
15
FIFO
0
b0
b1
b2
b3
b4
b5
b6
b7
b8
b9
b10
b11
b12
b13
b14
b15
Figure 40: Rx Processing in Buffered Mode (FIFO size=16, Fifo_fill_method=0)
5.4.4. Interrupt Signals Mapping
The tables below describe the interrupts available in Buffered mode.
Rx_stby_irq_x
00 (d)
-
Rx
-
Stby
IRQ_0
IRQ_1
01
10
11
00 (d)
01
10
11
Write_byte
/Fifoempty
Sync
-
Fifofull
RSSI
Fifo_threshold
-
/Fifoempty
-
-
Fifofull
-
Fifo_threshold
Table 20: Interrupt Mapping in Buffered Rx and Stby Modes
Tx
IRQ_0
Tx_irq_1=0 (d)
/Fifoempty
Fifofull
IRQ_1
Tx_irq_1=1
Tx_done
Table 21: Interrupt Mapping in Buffered Tx Mode
Rev 8 – February 2013
Page 46 of 92
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